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Processeurs de signaux et logique programmable

Mis à jour le

Responsable(s) : M. Lounis ZERIOUL

  • Cours + travaux pratiques
Code Cnam : ELE119-PAR
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  • Durée : 50 heures (+/- 10%)
  • A la carte
  • Soir & samedi
  • 6 crédits
  • Hybride (présentiel et distanciel)

Présentation

Public, conditions d'accès et prérequis

Prérequis

Avoir un niveau bac + 2, posséder des connaissances en électronique numérique combinatoire et séquentielle, en traitement de signal, en assembleur sur microprocesseur et avoir déjà utilisé un langage évolué tel que Basic, Fortran, C, Pascal...

Objectifs

  • Compléter sa formation en électronique numérique.
  • Programmer un processeur de signal (DSP) en C et en assembleur, pour réaliser des traitements en temps réel. 
  • Connaître les outils et les techniques de programmation de différents composants logiques programmables, principalement les FPGA, ainsi que les bases du langage VHDL.

L'avis des auditeurs

Les dernières réponses à l'enquête d'appréciation pour cet enseignement : Fiche synthétique au format PDF

Informations pratiques

Contact

Programme

Contenu

ELE119 est composée aux 2/3 de travaux pratiques.

Processeur des signaux (DSP)

  • Architecture des DSP, différences par rapport aux microprocesseurs
  • Chaîne d'acquisition et de traitement du signal,
  • Programmation en virgule fixe, notions d'optimisation et de profiling
  • Le DSP Texas TMS320C6713 : architecture, carte de développement, outil de développement (Code Composer)
  • Mise en œuvre de filtrages numériques, synthèse directe de fréquence, modulation et démodulation en prenant en compte les contraintes temps réels.
  • Découverte et utilisation de Code Composer.

Logique programmable

  • Les familles de circuits logiques programmables (PROM, PAL, EPLD, FPGA).
  • La technologie propre à chaque famille.
  • Les performances et les domaines d'utilisation.
  • Les outils de travail :
  • Saisie de schéma
  • Synthèse logique et langage VHDL
  • Simulation fonctionnelle et dynamique
  • Implémentation du circuit et test
  • Usage des outils XILINX.

Modalités d'évaluation

ELE119 est composée aux 2/3 de travaux pratiques. Les 4 séances de regroupement obligatoires servent à valider sur maquette FPGA/DSP les TP réalisés en simulation à la maison. 

Il y a 2 séances à la fin de la partie FPGA et 2 séances à la fin de la partie DSP. Un examen théorique d'environ une heure est organisé à la fin de chaque partie FPGA/DSP.

Bibliographie

  • C. ALEXANDRE . Processeurs de signaux et logique programmable. 2 parties
  • JESSE H. JENKINS . Designing with FPGAs and CPLDs (Prentice Hall)
  • C. TAVERNIER . Circuits logiques programmables (Dunod)

Formation mère

Processeurs de signaux et logique programmable

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